- •Способы описания динамических систем.
- •Использование моделирования при исследовании и проектировании технологических систем.
- •Аналоговое цифровое представление данных эвм
- •Способы коррекции погрешностей
- •Этап разработки проекта в LabView
- •Способы декомпозиции математических моделей.
- •Модель по методу последовательного программирования
- •Модель по методу совместного интегрирования
- •Методика разработки цифровых систем уравнения
- •Работа над типами данных с фиксированной точкой. Операция масштабирования.
- •Отсюда:
- •Программируемые интегральные схемы (пис)
Отсюда:
Масштабные уравнения получатся за счет приравнивания коэффициентов при входных переменных х1 и х2:
Значения машинных коэффициентов a1d и a2d определятся следующим образом:
Выражения и являются масштабами для представления машинных коэффициентов:
Эти масштабы необходимы для вычисления масштабов на выходах блоков Mul1 и Mul2
Опробуем предложенную методику масштабирования на уже известном нам генераторе гармонических колебаний, использующем рекуррентные выражения.
Приступим к выполнению Л.р.11 [стр.35 Методические Указания к лабораторным работам]
Программируемые интегральные схемы (пис)
Пис-электронный компонент с реконфигурируемой структурой, изменяемый в зависимости от поставленной задачи.
Плюсы ПИС по сравнению с микросхемами:
-
меньше энергопотребления.
Классы ПИС:
а) Программируемые матричные (СБИС)
кристаллы
б) Программируемые аналоговые (ПАИС)
+ размещение ОУ
больше точность
в) FPGA – программируемая пользователем вентильная матрица.
г) Электронные устройства реконфигурирования пользователем как с точки зрения связей между функциональными элементами, так и уменьшением функционала элемента.
д) ПЛБ – программный логический блок .
е) БВВ – блоки ввода/ вывода.
ж) ПРВС – программные ресурсы внутренней связи.
Трассировка ПЛИС – в месте пересечения создаются блоки коммутации.
Современное семейство FPGA имеют готовые функциональные блоки, реализованные на самом кристалле.
Способы высокоуровневого описания кода для ПЛИС:
1) HDL – язык описания аппаратного обеспечения. Язык среднего уровня.
2) VHDL – язык описания аппаратного обеспечения. Язык более высокого уровня.
3)AHDL – аналог HDL.
4) Verilog – разработка устройств на FPGA с помощью средств виртуализации.
Разработка устройств на FPGA с помощью средств реализации.
Проблемы проектирования:
а) высокие требования квалификации разработиков;
б) быстро изменяющиеся свойства аппаратных платформ;
в) трудности отладки готового кода.
Решение:
Построение виртуальной модели и эмуляция разрабатываемого устройства.
Масштабирование решателя дифференциальных уравнений.
Для перехода к фиксированной точке- операция масштабирования.
Масштабирование ДА. Тип I32.
-
Расчет масштабов выходных переменных
mznd =Maxd/ |Mzn| , где
Maxd - максимальное представимое значение машинной переменной.
Mzn - максимальная по модулю переменная, принемаемая z ,
Maxd – 232-1
a11d , a12d – машинные коэфициенты.
a11d= a11*h* Maxd* mz1/ mz2
a12d= a12*h* Maxd* mz1/ mz2
a21d= a21*h* Maxd* mz2/ mz1
a22d= a22*h* Maxd* mz2/ mz2
Этапы перехода к реализации FXP.
1) Расчет масштабов.
2) Расчет машинных коэфициентов.
3) Расчет машинных значений НУ.
4) Создание прбора Div/2.
5) Перевод значений const в I32.
6) Создание блока проверки решения.
7) Проверка если overflow -> возвращаемся DBL и смотрим где.
Реализация в FPGA.
Результатом модельного проектирования динамической системы является аппаратный прототип.
1) Создание проекта ->New ->project;
2) Открываем MAX- проверка допустимости CRIO ;
3) Добавить в проект на уровень Computer VI решатель;
4)Создать копию VI и переместить на уровень FPGA ;
5) Добавить в проект модули расширения (с-modul);
6) Из них выбрать 9263 и добавить элемент аналогового вывода ;
7)Перенести модуль АО на блок-диаграмму ;
8) Добавить модуль памяти FIFO;
9) Создать на уровне CRIO VI чтение из FIFO ;
10) Проверка полученного решения, оценка погрешности.